AULA 2 Implementação de Flip-Flops dos tipos JK e RS Livro Texto pág. 113 a 117 e 124 e 146 a 148 e 150 a 152.

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1 NOTA DE AULA NE7720 ITEMA DIGITAI - II AULA 2 Implementação de Flip-Flops dos tipos JK e R Livro Texto pág. 3 a 7 e 24 e 46 a 48 e 50 a 52..) Estudo do F/F tipo JK. a) Tabela da verdade do F/F tipo JK. J K Q n b) Tabela de Estados do F/F tipo JK. c) Equação de Estados do F/F tipo JK J K Q n Q n+ JK Q n+ = d) Tabela de Transição e) Diagrama de estados J K Q n Q n f) Implementação do F/F tipo JK utilizando-se de um latch-nand C. Representação esquemática da transformação do latch C para o F/F tipo JK. Tabela de Transição. K J Lógica de Transformação Lógica de transformação. C LATCH C-NAND Q n C Q n Q n+ X X JK = JK C = Pág. 6

2 NOTA DE AULA NE7720 ITEMA DIGITAI - II g) Circuito F/F tipo JK, assíncrono. i) F/F tipo JK síncrono. a) Borda de ubida. b) Borda de descida. J K Q n J K Q n j) Formas de Ondas no F/F tipo JK síncrono. 2.) Estudo do F/F tipo R a) Tabela da verdade do F/F tipo R. R Q n+ Pág. 7

3 NOTA DE AULA NE7720 ITEMA DIGITAI - II B) Tabela de Estados do F/F tipo R. C) Equação de Estados do F/F tipo R R Q n Q n+ R Q n+ = D) Tabela de Transição e) Diagrama de estados R Q n Q n f) Implementação do F/F tipo R utilizando-se de um latch-nand C. a) Representação esquemática da transformação do latch C para o F/F tipo JK. Tabela de Transição. R Lógica de Transformação a.) Lógica de transformação. C LATCH C-NAND Q n C Q n Q n+ X X R = R C = Pág. 8

4 NOTA DE AULA NE7720 ITEMA DIGITAI - II g) Circuito F/F tipo R, assíncrono. h) F/F tipo R síncrono. h.) Borda de ubida. h.2) Borda de descida. R Q n R Q n i) F/F tipo R síncrono borda de subida e descida. i.) Borda de descida i.2) Borda de subida i) Formas de Ondas no F/F tipo R síncrono. Pág. 9

5 NOTA DE AULA NE7720 ITEMA DIGITAI - II 3.) Entradas Assíncronas, preset e clear, borda de subida e descida, set-up e hold, associação de Flip-Flop do tipo T, contador assíncrono crescente e decrescente. a) Entradas Assíncronas Preset e Clear. PRE CLR D Q n b) FLIP FLOP tipo D síncrono borda de descida e com entradas assíncronas preset e clear. D PRE Q n CK F/F CLR b.) Formas de Ondas no F/F tipo D acima. b.2) Implementação de uma célula única para um F/F tipo D borda de subida com única entrada assíncrona. A tabela da verdade do circuito acima, fica : PE P i D Q n+ 0 X X 0 X X 0 X X 4.) TEMPO DE ET-UP (t ET-UP ) e de HOLDING (t hold ). Pág. 0

6 NOTA DE AULA NE7720 ITEMA DIGITAI - II 5.) Borda de ubida ou positiva ou borda de Descida ou negativa. a) Borda de ubida. b) Borda de Descida t p >> t p2 t p t p2 t p t p >> t p2 t p2 t p t p Problema: Construir um circuito lógico capaz de gerar uma saída de alarme A ALTO sempre que a porta ou a janela de um automóvel forem abertas. As entradas P e J são destinadas a sensorar respectivamente a porta e a janela do automóvel (P = e J = sensores ativos indicando porta e janela abertas). Uma chave R é ativa (R = ), quando o alarme se deseja deixar o alarme inativo. Pede-se: a) A tabela de estados do alarme A. b) Implementação do alarme usando latch-ne C. c) O circuito final. Pág.