Microprocessadores. CEFET-RS Curso de Eletrônica. Organização de Computadores. Profs. Roberta Nobre & Sandro Silva
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- Ana Sofia Sabrosa Balsemão
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1 CEFET-RS Curso de Eletrônica 1 - Evolução dos Microprocessadores Profs. Roberta Nobre & Sandro Silva robertacnobre@gmail.com e sandro@cefetrs.tche.br
2 Conceitos básicos Bit - binary digit -(b) Byte -8 bits -(B) Nibble - 4 bits Word - 16 bits (família PC) K - 1KiB M - 1MiB G - 1GiB T - 1TiB Unidade 01.2
3 Quadro evolutivo (1971) Primeiro microprocessador Intel (para a Busicom Japonesa) Barramento de Dados de 4 bits 2300 transistores Alimentação: 15V Clock: 108 KHz Busicom 141-PF printing calculator Unidade 01.3
4 Quadro evolutivo MCS-4(1971) Microcomputer System 4-bit 4001 ROM 4002 RAM 4003 shift register chip 4004 microprocessador Clock: 108 khz 60,000 operações/s 2300 trans. (10µm technology) Preço inicial: US$200 Intel Unidade 01.4
5 Quadro evolutivo (1972) Clock: 200 khz 1º microprocessador comercial de 8-bits 16 KB de memória 3500 transistores (10µm technology) 60,000 instruções por segundo Alimentação: +5V e -9V Mark-8 (1974) Microcomputador baseado no 8008 Unidade 01.5
6 Quadro evolutivo (1974) Clock: 2 MHz (0.64 MIPS ) Databus de 8-bits 64 KB de memória 6000 transistores (6µm technology) IMP-16 (1974) National Semiconductor Databus de 16-bit 1802 (1974) RCA Clock: 6.4 MHz considerado um dos primeiros processadores RISC da Intel Unidade 01.6
7 Quadro evolutivo (1974) Motorola Databus de 8-bits Clock: 1MHz MC6501 (1975) (clone do 6800) MOS Technology US$20 MC6502 (1975) MOS Technology, Inc. CPU do videogame Atari US$25. Unidade 01.7 Atari
8 Quadro evolutivo (1976) Intel Databus de 8-bits Addressbus de 16-bits Clock: 5 MHz (0.37 MIPS) 6500 transistors (3µm technology) Alimentação 5V simples SC/MP (1976) National Semiconductor Databus de 8-bits Multiprocessamento TMS9900 (1976) Texas Instruments O 1º microprocessador de 16-bits usado no minicomputador TI 990 TI 990 Unidade 01.8
9 Quadro evolutivo CP/M (1976) Control Program/Monitor Control Program for Microcomputers usado no 8080, Z80 e 8086 considerado o antecessor do DOS Z80 (1976) Zilog Clock: 2.5 MHz Databus de 8-bits Addressbus de 16-bits Set de instruções é um superset do Intel 8080 Unidade 01.9
10 Quadro evolutivo - computadores Computadores baseados no Z80 CP-500 Hot-Bit TRS-80 Sinclair Canon V-20 Unidade 01.10
11 Quadro evolutivo (1978) Intel 1 MB de memória Clock: 4.77 MHz (0.33 MIPS) Databus de 16-bits 29,000 trans. (3µm technology) US$ MHz (0.66 MIPS) MHz (0.75 MIPS) 8088 (1979) Intel Databus interno de 16-bits Databus externo de 8-bits Unidade 01.11
12 Quadro evolutivo Z8000 (1979) Databus de 16-bits (1979) Motorola Processador RISC Databus externo 16-bits Databus interno 32-bits 68,000 transistores Clock: 8MHz Unidade 01.12
13 Quadro evolutivo IBM PC ( 12 de agosto de 1981) 4,77MHz 256KB de memória (64KB na placa) Display (originalmente televisão) Monitor MDA opcional Armazenamento em fita cassete Unidade de disco flexível opcional 5 slots de expansão 8 canais de IRQ 4 canais de DMA Unidade 01.13
14 Quadro evolutivo (1982) Databus de 16-bits Address-bus de 24 bits (16M endereços) Memória virtual Modo protegido Pipeline de 4 estágios Clock de 6MHz a 20MHz IBM PC/AT 15 IRQs e 7DMAs 15 MB de memória SETUP (armazenado em CMOS de 50B) Teclado de 84 teclas Unidade de disco flexível de 1.2MB HD de 20MB PC-DOS 3.0 Placa de vídeo EGA Unidade 01.14
15 Quadro evolutivo (1984) Motorola Clock: 10MHz Unidade 01.15
16 Quadro evolutivo (1985) Barramento de Endereços de 32 bits (4G endereços) Barramento de Dados de 32 bits (real) Modo Real e Modo Protegido MMU Memória Cache (externa) Pipeline de 6 estágios Clock: 16MHz a 33MHz 80386SX Barramento de Dados de 16 bits (32 bit multiplexados) Unidade 01.16
17 Quadro evolutivo (1989) Barramento de Endereços de 32 bits (4G endereços) Barramento de Dados de 32 bits (real) FPU interna Cache interna (L1): 8K bytes Clock externo: 20MHz a 50MHz 80486SX (1991) sem FPU interna 80486DX2 (1992) Clock externo: 33MHz Clock interno (2x): 66MHz 80486DX4 (1994) Clock externo: 33MHz Clock interno (3x): 100MHz Unidade DX2 sem encapsulamento
18 Quadro evolutivo PENTIUM (1993) Barramento de Endereços de 32 bits (4G endereços) Barramento de Dados de 64 bits Primeiro processador superescalar ( 2 pipelines ) Registradores e ULA de 32 bits FPU para dados de 64 bits Lógica para previsão de desvios Cache interna de dados 8KB (L1) Cache interna de instruções 8KB (L1) Clock interno até 200MHz Unidade 01.18
19 Quadro evolutivo AMD 5x86 (1995) clone do PENTIUM Clock:133MHz FSB:33MHz Cache L1: 16KB Unidade 01.19
20 Quadro evolutivo Cyrix 5x86 (1995) Clock: 100MHz FSB: 33MHz Cache L1: 16KB Unidade 01.20
21 Quadro evolutivo Cyrix 6x86 (1995) Clock: 80MHz a 133MHz FSB: 40MHz a 66MHz Cache L1: 16KB Unidade 01.21
22 Quadro evolutivo PENTIUM PRO (1995) Clock: 133MHz a 200MHz FSB: 66MHz Cache L1: 16KB Cache L2: 256KB a 512KB 3 pipelines Unidade 01.22
23 Quadro evolutivo AMD K5 (1996) clone do PENTIUM Clock: 75MHz a 133MHz FSB: 50MHz a 66MHz Cache L1: 24KB alimentação: 3,52V Unidade 01.23
24 Quadro evolutivo PENTIUM MMX (1997) Clock: 133MHz a 233MHz FSB: 66MHz Cache L1: 32KB Instruções para multimídia Unidade 01.24
25 Quadro evolutivo Pentium II (Introduced May 7, 1997) Pentium Pro + MMX + melhor performace em 16-bits 242-pin Slot 1 (SEC) processor package Number of transistors 7.5 million 32 KB L1 cache 512 KB ½ speed external L2 cache The only Pentium II that did not have the L2 cache at ½ speed of the core was the Pentium II 450 PE. Unidade 01.25
26 Quadro evolutivo Pentium II Klamath 0.35 µm process technology 66 MHz system bus speed Family 6 model 3 Variants: 233 MHz Introduced May 7, MHz Introduced May 7, MHz Introduced May 7, 1997 Deschutes 0.25 µm process technology 66 MHz system bus speed (333 MHz variant), 100 MHz system bus speed for all models after Family 6 model 5 Variants: 333 MHz Introduced January 26, MHz Introduced April 15, MHz Introduced April 15, MHz Introduced August 24, MHz (Mobile) Introduced April 2, MHz (Mobile) Introduced April 2, MHz Pentium II Overdrive (Socket 8) Introduced August 10, 1998; 300 MHz (Mobile) Introduced September 9, MHz (Mobile) Unidade 01.26
27 Quadro evolutivo Celeron (Pentium II-based) Covington 0.25 µm process technology 242-pin Slot 1 SEPP Number of transistors 7.5 million 66 MHz system bus speed 32 KB L1 cache No L2 cache Variants: 266 MHz Introduced April, MHz Introduced June, 1998 Mendocino 0.25 µm process technology 242-pin Slot 1 SEPP Socket 370 PPGA package Number of transistors 19 million 66 MHz system bus speed 32 KB L1 cache 128 KB integrated cache Variants: 300 A MHz Introduced August, MHz Introduced August, MHz Introduced January, MHz Introduced January, MHz Introduced March, MHz e 500 MHz Introduced August, MHz Introduced January, MHz, 300 MHz e 333 MHz (Mobile) Introduced April, MHz, 400 MHz, 433 MHz e 450 MHz (Mobile) Intr Feb, MHz e 500 MHz (Mobile) Introduced February, 2000 Unidade 01.27
28 Quadro evolutivo AMD K6 (1997) Cache L1: 64K Clock interno de 166MHz a 300MHz Instruções MMX Unidade 01.28
29 Quadro evolutivo AMD K6-2 (1998) Cache L2: 256K Clock interno de 233MHz a 450MHz Instruções 3Dnow Unidade 01.29
30 Quadro evolutivo PENTIUM XEON (1998) Cache L1: 64K Clock interno de 166MHz a 300MHz Instruções MMX Unidade 01.30
31 Quadro evolutivo PII Xeon PENTIUM II e III XEON Variants: 400 MHz Introduced June 29, MHz (512 KB L2 Cache) Intr October 6, 1998 PIII Xeon 450 MHz (1 MB and 2 MB L2 Cache) Intr Jan 5, 1999 Number of transistors: 9.5 million at 0.25 µm ou 28 million at 0.18 µm L2 cache is 256 KB, 1 MB, or 2 MB (Integrated) S.E.C.C.2 or SC330 System Bus Speed: 133 MHz (256 KB L2 cache) ou 100 MHz (1-2 MB L2 cache) System Bus Width 64 bit Addressable memory 64 GB Used in two-way servers and workstations (256 KB L2) or 4- and 8-way servers (1-2 MB L2) Variants 500 MHz ( 0.25 µm process) Introduced March 17, MHz (0.25 µm process) Introduced August 23, MHz ( 0.18 µm process, 256 KB L2 cache) Introduced October 25, MHz (0.18 µm process, 256 KB L2 cache) Introduced October 25, MHz (0.18 µm process, 256 KB L2 cache) Introduced October 25, MHz (0.18 µm process, 256 KB L2 cache) Introduced January 12, MHz (0.18 µm process, 256 KB L2 cache) Introduced April 10, MHz (0.18 µm process, 256 KB L2 cache) 1000 MHz (0.18 µm process, 256 KB L2 cache) Unidade Introduced 01.31August 22, MHz (0.18 µm process, 1-2 MB L2 cache) Introduced May 22, 2000
32 Quadro evolutivo PENTIUM III (1999) Clock interno de 450MHz a 600MHz Instruções MMX2 slot1 -SEC PENTIUM III (1999) Clock interno de 600MHz a 1GHz Instruções MMX2 soquete FCPGA Unidade 01.32
33 Quadro evolutivo PENTIUM III (1999) Katmai 0.25µm process technology Improved PII Streaming SIMD Extensions (SSE) Number of transistors 9.5 million 512 KB ½ speed L2 External cache 242-pin Slot 1 SECC2 processor package System Bus: 100 MHz, 133 MHz Tualatin 0.13µm process technology Number of transistors 28.1 million 32 KB L1 cache 256 KB or 512 KB L2 cache Coppermine 0.18 µm process technology Number of transistors 28.1 million 256 KB L2 Cache (Integrated) 242-pin Slot-1 SECC2 package 370-pin FC-PGA Bus Speed 100MHz, 133MHz Variants 400 MHz (Mobile) Introd October 25, MHz (Mobile) Introd October 25, MHz (Mobile) Introd October 25, MHz 550 MHz (100 MHz bus speed) (Integrated) 600 MHz (Mobile) Introd January 18, MHz (100 MHz bus speed) Intr October 25, pin FC-PGA 650 MHz (Mobile) Introduced January 18, MHz Introduced October 25, MHz system bus speed 700 MHz (100 MHz bus speed) Intr October 25, 1999 Variants: Variants 700 MHz (Mobile) Introduced April 24, MHz Introduced February, MHz (256 KB L2) 733 MHz Introduced October 25, MHz (100 MHz bus speed)intr December 20, MHz Introduced February, MHz (512 KB L2) 750 MHz (Mobile) Introduced June 19, MHz Introduced May, MHz 800 MHz (100 MHz bus speed)intr December 20, MHz Introduced August, MHz (512 KB L2) 800 MHz (Mobile) Introduced September 25, MHz Intr(133MHz busspeed) Sep, MHz 850 MHz (100 MHz bus speed) Intr March 20, MHz Intr (133MHz busspeed) Sep, MHz (512 KB L2) 850 MHz (Mobile) Introduced September 25, MHz Introduced March 20, MHz (Mobile) Introduced March 19, MHz Introduced May 24, MHz (Mobile) Intr March 19, MHz Introduced March 8, 2000 Unidade Prof. MHz Roberta Nobre & Sandro Silva 1133 MHz
34 Quadro evolutivo Celeron (Pentium III Coppermine-based) Coppermine µm process technology Introduced March,2000 Streaming SIMD Extensions (SSE) Socket 370 PPGA processor package Number of transistors 28.1 million 66 MHz system bus speed 100 MHz system bus speed on January 3, KB L1 cache 128 KB Advanced Transfer L2 cache Variants 533 MHz 566 MHz 600 MHz 633 MHz Introduced June 26, MHz Introduced June 26, MHz Introduced June 26, MHz Introduced November 13, MHz Introduced November 13, MHz 850 MHz Introduced April 9, MHz Introduced July 2, MHz Introduced August 31, MHz Introduced August 31, MHz Introduced August 31, MHz Introduced October 2, MHz Introduced January 3, MHz (Mobile) 600 MHz (Mobile) Introduced June 19, MHz (Mobile) Introduced June 19, MHz (Mobile) Introduced September 25, MHz (Mobile) Introduced March 19, MHz (Mobile) 850 MHz (Mobile) Introduced July 2, MHz (LV Mobile) 500 MHz (ULV Mobile) Introduced January 30, Unidade MHz (ULV Mobile) Celeron (Pentium III Tualatin-based) Tualatin Celeron 0.13 µm process technology 32 KB L1 cache 256 KB Advanced Transfer L2 cache 100 MHz system bus speed Socket 370 Variants 1.0 GHz 1.1 GHz 1.2 GHz 1.3 GHz 1.4 GHz
35 Quadro evolutivo VIA C3 (1999) Clock interno de 550MHz a 866MHz FSB: 100MHz a 133MHz Cache L1: 128KB Unidade 01.35
36 Quadro evolutivo AMD ATHLON K7 (1999) Cache L1: 64K+64K (dados+instruções) Cache L2: 512K Clock interno de 550MHz a 650MHz FSB: Soquete A alimentação: 1,5V a 1,75V Unidade 01.36
37 Quadro evolutivo AMD Duron (2000) Cache L1: 64K+64K (dados+instruções) Cache L2: 64K Clock interno de 600MHz a 1.8GHz FSB: 200MHz a 266MHz Soquete A alimentação: 1,5V a 1,75V Unidade 01.37
38 Quadro evolutivo Pentium 4 (2000) Databus de 64-bits ULAs operam no dobro da freqüência Pipeline de 20 estágios Cache L1 de dados de 8KB Cache L1 de instruções de 12KB Instruções SSE2 Clock interno de 1.4GHz a 3.8GHz Execução especulativa e fora de seqüência Unidade 01.38
39 Quadro evolutivo Pentium µm process technology (1.4 e 1.5 GHz) Introduced November 20, 2000 L2 cache was 256 KB (Integrated) PGA423, PGA478 System Bus Speed 400 MHz SSE2 SIMD Extensions Number of Transistors 42 million Used in desktops and workstations 0.18 µm process technology (1.7 GHz) Introduced April 23, µm process technology (1.6 and 1.8 GHz) Introduced July 2, 2001 Core Voltage: 1.15V (Max Performance Mode) 1.05V (Battery Optimized Mode) Power <1 watt in Battery Optimized Mode Used in full-size and then light mobile PCs Willamette (1.9 and 2.0 GHz) Introduced August, 2001 Pentium 4 (2 GHz, 2.20 GHz) Introduced January, 2002 Pentium 4 (2.4 GHz) Introduced April, 2002 Northwood A 0.13 µm process technology 1.7, 1.8, 1.9, 2, 2.2, 2.4, 2.5, 2.6, 2.8, 3.0 GHz Improved branch prediction microcodes tweaks 512 KB integrated L2 cache Number of transistors 55 million 400 MHz system bus. Northwood B 0.13 µm process technology 2.26, 2.4, 2.53, 2.66, 2.8, 3.06 GHz 533 MHz system bus. hyper threading technology Northwood C 0.13 µm process technology 2.4, 2.6, 2.8, 3.0, 3.2, 3.4 GHz 800 MHz system bus Hyper Threading 6500 to MIPS Unidade 01.39
40 Quadro evolutivo Mobile Pentium 4-M 0.13 µm process technology 55 million transistors cache L2 512 KB BUS a 400 MHz Suporta até 1GB of DDR 266 MHz Memory ACPI 2.0 and APM 1.2 System Power Management 1.3 V V ( SpeedStep) Power: 1.2 GHz 20.8 W, 1.6 GHz 30 W, 2.6 GHz 35 W Sleep Power 5 W (1.2 V) Deeper Sleep Power = 2.9 W (1.0 V) 1.40 GHz - 23 April GHz - 23 April GHz - 4 March GHz - 4 March GHz - 23 April GHz - 24 June GHz - 24 June GHz - 16 September GHz - 14 January CEFETRS GHz January Eletrônica Organização GHz - 16 April de Computadores GHz - 11 June 2003 Pentium 4 EE (Extreme Edition) Introduced September 2003 Feito do Xeon's "Gallatin" core, com 2 MB cache Pentium 4E Introduced February µm ( 90 nm) process technology Prescott 2.4A, 2.8, 2.8A, 3.0, 3.2, 3.4, 3.6, 3.8 GHz 1 MB L2 cache 533 MHz system bus (2.4A and 2.8A only) Number of Transistors: 125million on 1 MB Models 169million on 2 MB Models 800 MHz system bus (all other models) Hyper-Threading support (versões de 800 MHz) pipeline increased from 20 stages to 31 stages 7500 to MIPS The 6xx series has 2 MB L2 cache and Pentium 4F Introduced Spring 2004 same core as 4E, "Prescott" GHz Unidade Intel bit extensions has also been incorporated
41 Quadro evolutivo Pentium 4F Prescott-2M 90 nm process technology GHz (model numbers 6x0) Introduced February 20, MB cache Intel 64bit Enhanced Intel SpeedStep Technology (EIST) Cedar Mill 65 nm process technology (model numbers 6x1) Introduced January 16, 2006 Unidade 01.41
42 Quadro evolutivo CELERON (2000) Soquete: FC PGA2 Clock: 1,1GHz FSB:100MHz Cache L1: 32KB Cache L2: 256KB Unidade 01.42
43 Quadro evolutivo ATHLON 4 (2001) Clock: 1,4GHz a 3,8GHz FSB:133MHz Cache L1: 128KB Cache L2: 256KB Unidade 01.43
44 Quadro evolutivo XEON (2001) Databus de 64-bits Unidade 01.44
45 Quadro evolutivo AMD ATHLON XP (2001) Databus de 64-bits Clock: 1533MHz a 2133MHz FSB: 133MHz Cache L1: 128KB Cache L2: 256KB Unidade 01.45
46 Quadro evolutivo Itanium (2001) Databus de 64-bits Unidade 01.46
47 Quadro evolutivo Itanium 2 (2002) Databus de 64-bits Unidade 01.47
48 Quadro evolutivo Opteron (2003) Databus de 64-bits Unidade 01.48
49 Quadro evolutivo Pentium M (2003) Databus de 64-bits Unidade 01.49
50 Quadro evolutivo Pentium Dual-Core (2003) Databus de 64-bits Pentium Dual Core Allendale (Introduced January 21, 2007) 65 nm process technology Desktop CPU (SMP support restricted to 2 CPUs) Duas CPUs em um único chip SSE3 SIMD instructions Number of Transistors 167 Million LaGrande Technology, enhanced security hardware extensions Execute Disable Bit EIST (Enhanced Intel SpeedStep Technology) iamt2 (Intel Active Management Technology), remotely manage computers LGA775 Variants: Intel Pentium E GHz (1 MB L2, 800 MHz FSB) Intel Pentium E GHz (1 MB L2, 800 MHz FSB) Intel Pentium E GHz (1 MB L2, 800 MHz FSB) Intel Pentium E GHz (1 MB L2, 800 MHz FSB) Unidade 01.50
51 Quadro evolutivo Semprom (2004) Databus de 64-bits Unidade 01.51
52 Quadro evolutivo Athlon 64 (2004) Databus de 64-bits Unidade 01.52
53 Quadro evolutivo Athlon 64 X2 (2004) Databus de 64-bits Unidade 01.53
54 Quadro evolutivo Turion 64 (2004) Databus de 64-bits Unidade 01.54
55 Quadro evolutivo Pentium D (2005) Databus de 64-bits Alimentação: 1,2V ~ 1,4V Primeiro processador multicore (junto com o Pentium Extreme Edition) Os dois núcleos se comunicam usando o FSB Suporta as mesmas tecnologias suportadas pelo Pentium 4. primeira geração: Smithfield. (2005): dois Pentium 4 Prescott CLK: 2,8GHz a 3,2 GHz Tecnologia: 90nm; L2: 1MB de cache por núcleo; FSB: 533 ou 800 MHz, half-duplex Soquete LGA775; não suporta: Hyper-Threading; e Tecnologia de Virtualização da Intel (Vanderpool.) Unidade 01.55
56 Quadro evolutivo segunda geração: Presler. (2006): dois Pentium 4 Cedar Mill CLK: 2.8, 3.0, 3.2 e 3.4 GHz Tecnologia: 65nm L2: 2MB de cache de por núcleo FSB: 800 Mhz Soquete LGA775 Pentium D (2005) não suporta: Hyper-Threading, pelo menos inicialmente. suporta: VT (Virtualization Technology) (Vanderpool) Tecnologia EM64T XD Bit EIST (Enhanced Intel SpeedStep Technology), disponível a partir do 2º trimestre de 2006 através de um update da bios da placa base. Unidade 01.56
57 Quadro evolutivo Pentium Extreme Ediction (2005) Databus de 64-bits Unidade 01.57
58 Quadro evolutivo Pentium Core (2006) Databus de 64-bits Unidade 01.58
59 Quadro evolutivo Pentium Core 2 (2006) Databus de 64-bits Unidade 01.59
60 Quadro evolutivo Pentium Core 2 (2006) Sucessor do Pentium 4 Arquitetura baseada no Pentium III com melhorias presentes no Pentium M Core 2 Duo (com núcleo duplo) Core 2 Quad (com núcleo quádruplo) Core 2 Extreme (para entusiastas) Core 2 Solo (com núcleo simples, para portáteis). Tecnologia: 45 nm a 65 nm Microarquitetura: Intel Core Conjunto de instruções: x86-64, MMX, SSE, SSE2, SSE3, SSSE3. Cache L1: 64KB (32 KB de dados + 32 KB de instruções) por núcleo Soquetes: Soquete T: LGA775 ou Soquete 775 Soquete M: FCPGA6 Soquete P Unidade 01.60
61 Quadro evolutivo Pentium Core 2 (2006) Núcleos L2 FSB CLK Allendale Core 2 Duo 2MB 800MHz 1800 MHz a 2400MHz Conroe Core 2 Duo e Core 2 Extreme 2MB ou 4MB 1066MHz a 1333MHz 1866 MHz a 3000MHz Merom Core 2 Duo (tensão padrão, baixa e ultra-baixa) 2MB e 4MB 533MHz a 800MHz 1066 MHz a 2600MHz Merom-L Core 2 Solo 1MB 533MHz 1066 MHz a 1200MHz Penryn Core 2 Duo (tensão padrão) 3MB e 6MB 800MHz 2100 MHz a 2500MHz Kentsfield Core 2 Quad e Core 2 Quad Extreme 8MB 1066MHz 2400 MHz a 2660MHz Yorkfield Core 2 Extreme 12MB 1333MHz 3000MHz Wolfdale Core 2 Duo 6MB 1333MHz 2667 MHz a 3167MHz Unidade 01.61
62 Quadro evolutivo Pentium Core 2 Duo (2007) Baseado na arquitetura do Pentium M e do Pentium III Arquitetura Core Cache L1 de 64KB (32 KB de dados + 32 KB de instruções) por núcleo Cache L2 compartilhada de 2 MB, 4 MB ou 8 MB. Tecnologia de dois ou quatro núcleos. Tecnologia de 65 nm e 45nm Soquete 775 Barramento externo de: 800 MHz (200 MHz transferindo quatro dados por pulso de clock), MHz (266 MHz transferindo quatro dados por pulso de clock) MHz (333 MHz transferindo quatro dados por pulso de clock). Instruções SSE3 e SS4 Execução dinâmica ampla: permite a execução de mais instruções por ciclo do clock, reduzindo o tempo de execução e o consumo de energia. Uso inteligente de energia: maior desempenho com redução no consumo de energia e desempenho mais inteligente da bateria. Acesso de memória inteligente: aumenta o desempenho do sistema pela otimização do uso da banda de dados disponível. Cache inteligente avançado: subsistema de cache mais eficiente e com mais desempenho. Boost de mídia digital: agiliza aplicativos multimidia. Unidade 01.62
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